已知問題:VisualApplets 版本 3.1.1#
在安裝有 Vivado 2017.2 或 Vivado 2017.3 的電腦上進行 Windows 10 Fall Creators 更新(版本 1709)
請遵循 Xilinx 支援提供的因應措施,讓您的 Xilinx Vivado 2017.2 或 2017.3 安裝恢復正常運作。(請參閱 https://www.xilinx.com/support/answers/69908.html)。
Windows 在安裝了 ISE 14.7 或 2017.4 之前版本的 Vivado 的電腦上,安裝 2017 年 7 月 10 日發布的 10 x64(版本 1803)累積更新(KB4338819)
如果您安裝上述 Windows 10 更新,使用早於 Vivado 2017.4 的 Xilinx 工具時,建置流程之後可能無法正常運作。因此,您可能無法建置使用 VisualApplets 建立的設計。
對於早於 Vivado 2017.4 的 Vivado 版本,Xilinx 工具鏈的日誌輸出中可能會出現錯誤訊息,指出某些黑盒實例的內容未定義。至於 ISE®,甚至無法確定Xilinx 工具的版本,導致 FPGA 類型檢查失敗。不過,ISE® 的 32 位元工具鏈仍可正常運作(請變更建置設定:對於Xilinx 設定批次檔,請使用 settings32.bat 取代 settings64.bat)。
Follow the work-around provided by Xilinx Support to make the ISE installation work again (See https://www.xilinx.com/support/answers/62380.html, section ISE 14.7 64bit - Turning off SmartHeap). The same work-around can be used for Vivado where you need to perform the file substitution actions in the folder \<VivadoInstallDir>/ids_lite/ISE/lib/nt64. |
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在程式目錄中以非特定使用者方式安裝 VisualApplets(Windows)會導致存取問題。
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當您使用 Xilinx Vivado Tools 建置 applet 時,可能會收到嚴重警告(在建置步驟 LinkDesign 中)。這些警告是由 Xilinx 工具鏈中的問題所引起的。Xilinx 已知悉此問題,目前正在修復中。然而,由於此問題對於在 VisualApplets 中建立的設計**並不嚴重**,因此可以忽略這些警告。例如:
CRITICAL WARNING: [Shape Builder 18-137] Cannot obey LUTNM/HLUTNM constraint for instances …/PART1174 and …/PART1175. Illegal to place instance …/PART1174 on site SLICE_X2Y0. The location site type does not match the instance type. Instance …/PART1174 belongs to a shape with reference instance …/PART1175. Shape elements have relative placement respect to each other. The invalid location might results from a constraint on any of the instance in the shape.. -
檔案名稱:命名 *.va 檔案時,僅能使用基於 ASCII 字元的字型;這表示例如不支援亞洲字型、斯拉夫語字型、希臘語字型或阿拉伯語字型作為檔案名稱。
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針對 microEnable 5 marathon 和 LightBridge擷取卡的設計中的頻寬對話方塊:針對記憶體型運算子顯示的值並不準確。記憶體運算子的實際資料傳輸量可能會有所不同,因為頻寬分析未將 marathon 和 LightBridge 擷取卡中實作的共用 RAM 概念納入考量。如果某個運算子與其他運算子共用 RAM,頻寬分析將無法偵測到此情況,因此不會反映在顯示的數值中。
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只有最先啟動的 VisualApplets 執行個體才能儲存其組態。所有稍後啟動的 VisualApplets 執行個體都只有暫時組態,當關閉執行個體時該組態將被捨棄。這涉及例如建置設定、程式庫設定、系統設定、一般 VisualApplets 設定。
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階層式方塊 (Hierarchical Boxes):如果您使用階層式方塊,在某些特定情況下,設計規則檢查 (Design Rule Check) 可能會出現以下錯誤訊息:「運算子 ABC(階層式方塊)的輸入 XYZ 必須連接至 O 型運算子,例如 NOP。」原因是因為放置在階層式方塊內的某些 M 型運算子無法直接連接至階層式方塊的輸入連接埠。這僅適用於某些特定的 M 型運算子。您可以透過在階層式方塊的輸入連接埠與 M 型運算子的輸入連接埠之間放置一個 NOP 運算子來解決此問題(在階層式方塊內)。
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CXP 的 SDK:對 SISO_GenICam 程式庫的存取不會自動產生,必須由使用者進行程式設計。
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若要變更 applet,必須透過韌體燒錄工具 (microDiagnostics) 將 microEnable 5 平台的 applet 載入擷取卡上。
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頻寬分析顯示的數值並不精確,僅供參考。請非常謹慎地使用此功能,並在目標硬體上執行額外測試。核心運算情況下的頻寬計算不會將核心尺寸納入考量。
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色彩程式庫的運算子應謹慎使用:某些色彩轉換的運作方式可能不符合使用者的預期:
- HSI2RGB 將 HSL 轉換為 RGB,
- RGB2YUV 將 RGB 轉換為 YCbCr,
- XYZ2LAB 根據以下定義使用常數:www.easyrgb.com
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運算子
FIRKernelNxM當參數EdgeHandling設為常數、欄數 > 2*Parallelism、核心欄數為偶數且 Parallelism > 1 時,可能會導致處理錯誤。此錯誤可在影像的左邊框監控到,該處在畫面內的核心位置使用了錯誤的像素資料。 -
模擬錯誤發生後,需要重設模擬條件。
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將 applet 載入擷取卡期間的初始化階段,觸發運算子可能會在觸發輸出端產生突波。
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關於作業系統 Microsoft Windows 8 和 7 32位元/64位元、Microsoft Windows Vista 32位元/64位元以及 Microsoft Windows XP 64位元的重大注意事項:必須且建議將使用者資料夾定義為目標資料夾。或者,也可以使用任何其他具有完整存取權限的資料夾。
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DMA 資源索引必須從零開始並連續編號。這將由 DRC 進行檢查。
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此運算子
ImageBufferMultiRoiDyn在輸入影像極小時,可能會導致時序錯誤。 -
此運算子
ImageSequence可能會導致建置錯誤(時序錯誤)。(2422) -
BAYER5x5Linear:在某些情況下,VisualApplets 中此運算子的資源估算(於對話框 FPGA Resource Usage中)可能會與 Xilinx 工具在進行 Place & Route 後所顯示的估算結果有所不同。(6426) -
在某些情況下,若變更設計的平台,於進行設計規則檢查時可能會出現錯誤訊息「參數值無效:不接受 RamDataWidth」。當新目標平台的記憶體佈局與先前平台不同時,使用 RAM 資源的模組可能會發生此情況。要解決此問題,請儲存並重新載入設計。(8708)
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運算子
ModuloCount: 參數Devisor理論上可設定為最高 64 位元的值,但若任何參數化設定的值高於 32 位元,將導致VisualApplets 在模擬過程中發生當機。(8901) -
DynamicROI:在特定條件下,運算子DynamicROI會輸出錯誤的行長度(輸出行長度被錯誤地延長了一個平行字組)。此錯誤僅在同時滿足以下三個條件時才會發生:- Parallelism 不是 2 的冪次方,
- Xoffset 可被 parallelism 整除,以及
- Xlength 可被 parallelism 整除。
如果未滿足其中一個條件,運算子
DynamicROI即可正常運作。此錯誤發生在 FPGA 實作中。模擬會模擬正確的運算子行為。(7722) -
當
SampleDn運算子與可被 2 整除的取樣因數以及大於 1 的 parallelism 一起使用時,會產生損毀的影像。 -
自訂運算子、記憶體存取:使用特定的存取模式時,自訂運算子的記憶體存取會在 VisualApplets 3.0.6、3.1、3.1.1 和 3.1.2 版本中導致資料損毀。此問題已在 VisualApplets 3.2 版本中修正。
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當您模擬大於 2 GB 的影像之設計時,VisualApplets 可能會當機。作為因應措施,請使用小於 2 GB 的影像進行模擬,並將您的 VisualApplets 升級至 3.3.2 或更高版本。從 3.3.2 版本開始,VisualApplets 不會再當機,但在使用大於 2 GB 的影像執行模擬時會出現錯誤訊息。(240989)